当领导全球半导体产业发展“摩尔定律”逐步失效后 ，在先进光刻技术获取受限且不太经济的大布景下 ，华为提出了“韬（τ）”定律 ，作为接下来领导半导体行业发展的新规定。
5月25日 ，2026国际电路与系统钻研会在上海进行 ，华为公司董事、半导体业务部总裁何庭波在会上颁发了《半导体新蹊径索求与实际》的宗旨演讲 ，正式颁发“韬（τ）定律”。这是中国在全球半导体领域初次提出领导产业发展的新准则。
必要指出的是 ，华为不仅是颁发“韬（τ）”定律自身 ，还带来了多款芯片的实证。这对中国半导体产业链都是极大提振。25日当天 ，中国半导体造作产业链有关股价大幅上涨 ，中芯国际（688981.SH）靠近涨停 ，华虹公司（688347）20%涨停 ，半导体设备股拓�？萍迹�688072.SH）、盛美上海（688082.SH）均大幅上涨。
统一天 ，何庭波在中国科学院科技论文预颁布平台上颁发署名论文《多层电子系统的功夫缩微理论（A Time Scaling Theory for Multi-Layer Electronic Systems）》 ，该论文对“韬定律”进行了具体的诠释和注明。
韬定律提出以“功夫（τ）缩微”代替“几何缩微”作为半导体与电子系统演进的新领导准则——通过逻辑折叠等创新技术 ，持续压缩信号传布时延 ，不休提升晶体管密度 ，从而实现半导体与电子系统的持续演进。
戈登·摩尔（Gordon Moore）于1965年观察到晶体管密度约莫每两年翻一番 ，十年后 ，罗伯特·丹纳德（Robert Dennard）的缩放理论对此进行了补充。该理论指出 ，电压和尺寸的成比例缩幼能够维持电场强度恒定。几何缩放和丹纳德缩放共同作用 ，在近五十年的功夫里 ，实现了每瓦机能和每美元机能的指数级提升。
何庭波在论文中明确指出 ，摩尔定律这个行业左券如今已不再合用。在7纳米节点之后 ，几何级数缩放不再像从前那样带来显著效益。2纳米节点的尖端芯片设计预算超过了10亿美元。
基于这些行业近况和企业现实情况 ，从前六年 ，华为半导体团队在移动SoC、AI加快器、系统架构和封装等领域 ，对这个问题进行了深刻钻研。最终结论是 ，答案并非在于选取新的造程节点或晶体管架构 ，而在于扭转重要的优化指标自身。
华为以为 ，未来十年电子系统的发展方向不应是几何缩放 ，而应是功夫缩放——即系统性地降低堆叠每一层中单一特点功夫常数τ ，从皮秒级晶体管开关到秒级数据中心工作负载响应。
基于该定律 ，华为从前六年已成功设计并量产了381款芯片。今年秋季 ，华为将颁布新的麒麟手机芯片 ，齐全选取逻辑折叠技术 ，大幅提升有关机能。
Omdia中国区半导体分析师总监何晖接受澎湃新闻记者采访时暗示 ，韬定律的道理 ，就是将通讯网络中高传输 ，低时延道理使用到了芯片内部 ，而不只是单纯依赖先进造程带来微缩空间 ，增长晶体管数量来实现机能提升。
何晖进一步诠释 ，在先进造程受限确当下 ，结合华为自身的技术优势 ，通过利用通讯方面的技术特点 ，再结合改进介质等方式来添补物理极限的限度 ，追求其他的技术得救蹊径。
何庭波在论文中指出 ，摩尔定律性质上并非几何状态 ，而是对最终用户影响最大的技术。更幼的晶体管之所以能提升系统机能 ，是由于它们切换速度更快。更密集的互连线之所以能提升机能 ，是由于信号传输距离更短。更高的集成度之所以能提升机能 ，是由于数据逾越的天堑更少。每一代技术带来的性质上都是功夫的缩短——器件层面从皮秒到纳秒 ，芯片层面从纳秒到微秒 ，系统层面从微秒到秒�？占渌醴沤鼋鍪茄顾豕Ψ虻墓ぞ�。
因而 ，功夫自身应该被用作重要衡量尺度。在仓库的每一层——晶体管、电路、芯片和系统——都能够界说一个特点功夫常数τ ，并将其缩减作为统一优化指标。几何缩微由此成为缩减τ的多多技术伎俩之一 ，而不再是唯一的伎俩。
奥尔布赖特石桥集团（ASG）合资人、副总裁兼中国科技政策掌管人保罗·特里奥洛解读“韬定律”时暗示 ，华为的思路是斩钉截铁的 ，未来半导体发展的进取 ，不再重要依赖几何尺寸的缩幼 ，而是通过在器件、电路、芯片、系统等各个层面 ，压缩有效常数τ来实现。在器件层面 ，这种机造降低电阻和电容。在电路层 ，这意味着通过三维“逻辑折叠”架构来缩短导线和信号蹊径。在芯片层 ，它意味着软硬件架构与硅片协同设计。在系统层 ，它意味着削减通过统一的内存语义和缜密集成的SuperPod ，实现互联延长的优化。
对于“逻辑折叠” ，特里奥洛以为 ，华为将其描述为从传统的二维布局转向垂直堆叠架构 ，其中多个平面逻辑层沿着Z轴向上折叠�；褂玫睦啾仁牵捍拥ゲ阕≌蚨嗖愎怪� ，通过电梯衔接楼层。这样做的指标极度直接：在不齐全依赖晶体管尺寸缩幼的情况下 ，通过削减信号传布距离、缩短关键蹊径、提升有效晶体管密度 ，以实现机能的提升。
论文显示：τ缩微的初次量产规模测试在移动设备领域发展。智能手机SoC的特殊之处在于 ，单个芯片组成了整个系统。多插槽并行架构无法实现；即便占有上千个节点 ，也无法添补链路速度慢的问题。所有交付给用户的机能都源自单个芯片 ，功耗仅为几瓦 ，并且受得手持设备表形尺寸限度带来的散热限度。
此表 ，2020年之后 ，随着先进造程节点的获取受到限度 ，关键问题造成了：在造程节点固定的情况下 ，若何在单个芯片上持续实现代际机能提升？
华为说 ，最终的答案就是逻辑折叠（LogicFolding）。逻辑折叠是一种设计步骤 ，它将数字电路、仿照电路和存储电路划分到垂直堆叠的有源层中 ，遵循功夫缩放准则 ，从而在机能、功耗和面积之间实现协同优化。
何庭波在会上说 ，“麒麟2026”手机芯片是逻辑折叠技术的初次成功执行。它基于全新的自由逻辑设计理想 ，由单层扩大至了双层 ，并实现晶体管密度等指标的大幅提升。“我们获得了一系列仅靠先进造程工艺难以获得的进取。”何庭波说 ，诸如此类的大量创新 ，会逐步落地到2027年及之后的量产芯片中。
特里奥洛以为 ，这在技术上并非齐全新鲜。半导体行业多年来一向在朝这个方向发展 ，好比英伟达此刻的优势不仅在于晶体管密度 ，更在于系统级集成。AMD也在钻营幼芯片堆叠和先进封装技术。苹果M系列的成功 ，好多水平上也归功于内存的本地化以及硬件与软件的垂直集成。“华为的做法是将这些趋向加以提炼 ，并将其提升为全面的后摩尔定律时期的解决规划。”
凭据论文 ，在移动 SoC上 ，逻辑折叠（LogicFolding）在固定器件节点（即造程工艺不变）下 ，实现了55%的晶体管密度阶跃式提升 ，以及41%的能效增益。论文预计 ，到2031年 ，在器件和电路层面 ，晶体管密度将从155 MT/mm?（百万晶体管/平方毫米）提升到400+ MT/mm?�；俜叫挛鸥逯性蛐绰� ，到2031年 ，基于韬定律的高端芯片晶体管密度将达到1.4纳米造程的一致水平。
在全球半导体的竞争中 ，中国半导体产业由于先进光刻技术受限 ，接受的挑战和压力最大。但华为提出的韬定律以及多款芯片实证 ，为中国半导体甚至于全球半导体产业后摩尔时期的持续演进找到了一条新方向。
从2020年5月到2026年5月 ，华为半导体设计并量产了381款芯片 ，服务于移动、人为智能、汽车、工业和基础设施市场。在这些产品组合中 ，τ缩微理论得到了验证。
华为在论文中暗示 ，瞻望未来 ，CPU主题频率预计到2029年将达到4GHz及以上 ，麒麟SoC的能效预计在三到五年内典型使用情况下将提升一倍以上 ，而人为智能硬件集成度预计到2035年将增长100倍以上。
何庭波说 ，2026到2035年 ，随着大量索求性的技术逐步产品化 ，晶体管的密度将持续提升 ，工作频率将持续增长 ，将持续推出机能卓越的手机芯片。“CA88解决规划走得通 ，走得远。我们新芯片的机能齐全能够持续对标另表一条蹊径。”
针对半导体行业未来的发展 ，何庭波暗示：“未来肯定属于盛开合作。在‘韬定律’的蹊径下 ，我们等待与全球科学家、工程师和产业同伴缜密合作 ，共同推动半导体与电子产业持续发展。”
何晖以为 ，华为这次对暴露出 ，自身也展示了一种态度。通过系统级的优化 ，而不是单纯比拼物理极限 ，在硅材质摩尔定律靠近极限确当下 ，也未尝不是一种积极的尝试。
上海财经大学特聘教授、专事智能科技产业和智能经济钻研的胡延平以为 ，“韬定律”现实上约蹬宗解锁了华为式的芯片推算时空观 ，以自由逻辑变道理、以物理优化缩常数、以逻辑折叠增密度、以全栈协同提效能、以系统沉构降时延；这是一种分歧于过往造程精度、DUV屡次曝光、良率等视角的新系统 ，拥有多维技术融合演进的新特点 ，且不齐全只是做加法、做优化。业界可能不仅要看逻辑折叠 ，更要看自由逻辑设计理想到底是什么。
胡延平暗示 ，“韬定律”能够既是一次理论创新 ，也是一次实际拓新。路走着走着 ，就逐步走远 ，走出过往熟悉的半导体产业地带了。
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